美國加州圣何塞（2014年9月26日）-全球知名的電子設計創(chuàng)新領導者Cadence設計系統(tǒng)公司(NASDAQ:CDNS)今日宣布為臺積電16納米FinFET+制程推出一系列IP組合。Cadence所提供的豐富IP組合能使系統(tǒng)和芯片公司在16納米FF+的先進制程上相比于16納米FF工藝，獲得同等功耗下15%的速度提升,、或者同等速度下30%的功耗節(jié)約,。

    目前在開發(fā)16 FF+工藝的過程中,，Cadence的IP產品組合包括了在開發(fā)先進制程系統(tǒng)單芯片中所需的多種高速協(xié)議,，其中包括關鍵的內存、存儲和高速互聯(lián)標準,。IP將在2014年第四季度初通過測試芯片測試,。有關IP產品和銷售時間的詳細信息，客戶可聯(lián)系Cadence當?shù)氐匿N售人員

    Cadence在今天還宣布了其針對16納米FinFET+制程的數(shù)字實現(xiàn),、簽收和定制/模擬設計工具已獲得臺積電認證,，詳細內容，請點擊Click here

    臺積電設計基礎架構市場部高級總監(jiān)李碩表示：“我們16納米FinFET+制程對于下一代單芯片設計至關重要,，它們平衡了設計中性能,、功耗和面積的難題。作為臺積電長期可信任的合作伙伴,，我們相信在這一新制程被廣泛采用的過程中,，Cadence提供的驗證過的工具和IP會扮演非常重要的作用。”

    Cadence高級副總裁和IP部門總經理MartinLund指出：“我們針對16納米FinFET+制程的豐富IP組合將使設計團隊能快速進入下一代系統(tǒng)單芯片的設計,、并體驗到新FinFET制程的性能和功耗優(yōu)勢,。”

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    Cadence公司成就全球電子設計技術創(chuàng)新，并在創(chuàng)建當今集成電路和電子產品中發(fā)揮核心作用,。我們的客戶采用Cadence的軟件,、硬件、IP,、設計服務,，設計和驗證用于消費電子、網絡和通訊設備以及計算機系統(tǒng)中的尖端半導體器件,。公司總部位于美國加州圣荷塞市,，在世界各地均設有銷售辦事處,、設計中心和研究機構,，以服務于全球電子產業(yè)。關于公司、產品及服務的更多信息,，敬請點擊here,。