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Marvell支持下一代數(shù)據(jù)中心及汽車 AI 加速器 ASIC

為業(yè)界首款 每秒千萬(wàn)億次運(yùn)算(peta OP/s AI) 芯片加速器提供發(fā)展動(dòng)力
2020-10-13
來(lái)源:Marvell
關(guān)鍵詞: Marvell 數(shù)據(jù)中心 AI ASIC

北京訊(2020 年 10 月 13 日) - 數(shù)據(jù)基礎(chǔ)設(shè)施半導(dǎo)體解決方案的全球領(lǐng)導(dǎo)廠商Marvell(NASDAQ:MRVL)今日宣布,其定制化專用集成電路 (ASIC) 產(chǎn)品完全有能力為數(shù)據(jù)中心和汽車市場(chǎng)提供下一代人工智能 (AI) 加速器解決方案,。

Marvell的定制化 ASIC 產(chǎn)品為 AI 及機(jī)器學(xué)習(xí)應(yīng)用提供了不同功能,,包括具備領(lǐng)先密度和性能的 SRAM、最高性能的 SerDes 和全系列預(yù)認(rèn)證的高帶寬內(nèi)存接口,。它同時(shí)擁有最新的 PCI-Express (PCIe) 和 IO 技術(shù),,包括定制的多抽頭,、多級(jí),、高驅(qū)動(dòng)的時(shí)鐘元件,。 該 IP 由Marvell設(shè)計(jì)并通過(guò)資格預(yù)認(rèn)證,以實(shí)現(xiàn)卓越的性能與可靠性,。

Marvell的 ASIC 產(chǎn)品通過(guò)交鑰匙設(shè)計(jì)和驗(yàn)證以及定制網(wǎng)狀互聯(lián)芯片通信,,可確保以最快的速度推向市場(chǎng)。此外,,Marvell的 ASIC 方法具有用于降低功耗的自適應(yīng)電壓供應(yīng),,以及定制的分層測(cè)試方法,、邏輯冗余和用于增強(qiáng)可靠性的自定制存儲(chǔ)器 BIST 解決方案,。 Marvell支持多種 ASIC 參與模式,從提供完全交鑰匙產(chǎn)品到進(jìn)行客戶擁有的物理設(shè)計(jì),,可供客戶選擇來(lái)優(yōu)化其差異化模塊,。 無(wú)論客戶采用何種參與模式,,從物理設(shè)計(jì),、測(cè)試設(shè)計(jì)、功率和時(shí)序優(yōu)化到仿真,、ATPG 和制造測(cè)試、原型制作再到生命周期始末的可靠性所有權(quán),,Marvell都會(huì)提供合格的整套流程,。

Marvell正與許多數(shù)據(jù)中心和汽車制造商合作,以開發(fā)定制的 AI ASIC,。Groq 利用其 ASIC 產(chǎn)品拓展了Marvell的創(chuàng)新公司客戶名單,,正致力于創(chuàng)建業(yè)內(nèi)首個(gè)每秒 可運(yùn)算千萬(wàn)億次的(peta operations per second, POP/s) AI 加速芯片。

Groq 首席執(zhí)行官 Jonathan Ross 表示:“我們與Marvell的 ASIC 合作取得了非比尋常的成果,。我們知道,,想要擺脫 FPGA、CPU 和 GPU 等傳統(tǒng)架構(gòu)的束縛,,并打造業(yè)界前所未見的革命性產(chǎn)品,需要一個(gè)獨(dú)特的合作伙伴,。Marvell助力了我們首款也是唯一一款支持每秒 peta 運(yùn)算的處理器愿景,,并使之成為現(xiàn)實(shí)。他們是為數(shù)不多的既能創(chuàng)新又能實(shí)現(xiàn)創(chuàng)新的 ASIC 團(tuán)隊(duì)之一,?!?/p>

Marvell ASIC 事業(yè)部總經(jīng)理 Kevin O'Buckley 表示:“這些最新的定制 化ASIC 設(shè)計(jì)脫胎于超過(guò) 25 年的 ASIC 設(shè)計(jì)經(jīng)驗(yàn)和領(lǐng)先能力,最終實(shí)現(xiàn)了最復(fù)雜的加速器,、存儲(chǔ)和車載解決方案,。通過(guò)采用獨(dú)特的 IP、設(shè)計(jì),、布局和測(cè)試流程,,我們能夠與客戶合作,創(chuàng)造業(yè)界最復(fù)雜,、性能最高的 AI 加速器芯片,,并迅速投放市場(chǎng)?!?/p>

Marvell的設(shè)計(jì)合作伙伴關(guān)系的關(guān)鍵因素包括具有抽象和分布式計(jì)算的分層設(shè)計(jì)實(shí)施,、超穩(wěn)健的配電和電源完整性建模、具有邏輯冗余的定制分層測(cè)試方法,、用于系統(tǒng)和測(cè)試時(shí)鐘的全芯片實(shí)用的傾斜結(jié)構(gòu)時(shí)鐘網(wǎng)絡(luò),、一個(gè)設(shè)計(jì)分析儀表盤,以及最終網(wǎng)絡(luò)列表在 85 天內(nèi)即可完成,。



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