基于UltraScale架構FPGA的DDR3用戶接口優(yōu)化系統(tǒng) | |
所屬分類:技術論文 | |
上傳者:wwei | |
文檔大?。?span>4866 K | |
標簽: XCKU060 DDR3 SDRAM 讀寫方案優(yōu)化 | |
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文檔介紹:為滿足高速傳輸系統(tǒng)領域對于實時,、高速數(shù)據(jù)采集與緩存的需求,,結合Xilinx 提供的基于UltraScale架構的XCKU060,,在了解FPGA與DDR3相應節(jié)點的定義與特性的基礎上,對其引腳進行合理分配連接,,使其能夠成功在IP核上運行使用,。為了方便用戶在軟件方面的使用,在此基礎上對其控制器接口引入讀寫FIFO和讀寫邏輯控制模塊,,優(yōu)化了接口封裝,,并在VIVADO軟件對讀寫過程進行測試。該方法可滿足高速,、大容量,、實時數(shù)據(jù)的讀寫要求,充分發(fā)揮了DDR3存儲的靈活性,。 關鍵詞:XCKU060,;DDR3 SDRAM;讀寫方案優(yōu)化,;IP核應用,;FPGA引腳分配;數(shù)據(jù)采集存儲 | |
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