基于最佳接收的UART的設計與實現
所屬分類：技術論文
上傳者：aet
文檔大小：2073 K
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文檔介紹：針對通用異步接收和發(fā)送器UART對隨機脈沖干擾特別敏感的弱點，引入數字相關器，以實現信號的最佳接收及提高UART的抗干擾性能；結合現場可編程邏輯門陣列FPGA的結構特點針對同步模塊和數字相關器等關鍵部件進行邏輯設計優(yōu)化，使UART性能大為提高。
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