《電子技術(shù)應(yīng)用》
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Mentor推硬件加速仿真APP 提升設(shè)計(jì)效率

2016-03-22
作者:楊慶廣
來(lái)源:電子技術(shù)應(yīng)用
關(guān)鍵詞: Mentor Veloce2 仿真平臺(tái) APP

       一般情況下硬件電路設(shè)計(jì),,在仿真的時(shí)候大多是采用軟件仿真方式,,這種方式在硬件電路相對(duì)簡(jiǎn)單的過(guò)去還可以滿(mǎn)足電子工程師的需求。而在硬件電路日趨復(fù)雜的現(xiàn)在已經(jīng)越來(lái)越難以滿(mǎn)足實(shí)際設(shè)計(jì)需求,。為此,,硬件加速仿真的推出就必不可少。在硬件加速仿真領(lǐng)域Mentor Graphics有著豐富的經(jīng)驗(yàn),,已經(jīng)把硬件仿真推進(jìn)到了第四個(gè)階段——應(yīng)用程序階段,。在該階段中,,單個(gè)硬件不再是區(qū)分因素,在硬件和操作系統(tǒng)上運(yùn)行的應(yīng)用程序?qū)?a class="innerlink" href="http://forexkbc.com/tags/仿真平臺(tái)" title="仿真平臺(tái)" target="_blank">仿真平臺(tái)轉(zhuǎn)換成驗(yàn)證中心來(lái)工作,,應(yīng)用程序驅(qū)動(dòng)使用新模型來(lái)減少SoC驗(yàn)證任務(wù)從而為硬件仿真加速,。

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硬件仿真發(fā)展的四個(gè)階段

       Veloce2 是Mentor公司的硬件仿真平臺(tái),目前運(yùn)行Veloce OS3 操作系統(tǒng),,可針對(duì)當(dāng)今復(fù)雜的片上系統(tǒng) (SoC) 設(shè)計(jì)實(shí)現(xiàn)完整的功能驗(yàn)證,。其自定義片上硬件仿真技術(shù)可提供高可靠的編譯、類(lèi)軟件仿真似的交互式調(diào)試,、超高的吞吐率以及快速驗(yàn)證收斂時(shí)間,。

       為了進(jìn)一步提升硬件仿真效率,Mentor近期還推出了用于 Veloce?硬件仿真平臺(tái)的新型應(yīng)用程序(APP),,包括 Veloce Deterministic ICE,、 Veloce DFT 和 Veloce FastPath,可以解決復(fù)雜 SoC 和系統(tǒng)設(shè)計(jì)中的關(guān)鍵系統(tǒng)級(jí)驗(yàn)證難題,。相比以硬件為中心的策略,, Veloce OS3 上的 Veloce Apps 組合使用可以更快速地向更多工程師提供更豐富的功能。

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Mentor APP架構(gòu)圖

       Mentor推出的三個(gè)APP,,可以說(shuō)是在硬件仿真領(lǐng)域劃時(shí)代的進(jìn)步,。這對(duì)于提升硬件仿真平臺(tái)靈活度和效率有著至關(guān)重要的作用。每種新型 Veloce Apps 均可解決一項(xiàng)特定驗(yàn)證問(wèn)題,。

       其中,,Veloce Deterministic ICE 在調(diào)試過(guò)程中加入了 100%可見(jiàn)性和可重復(fù)性,從而克服了電路內(nèi)仿真 (ICE) 環(huán)境的不可預(yù)知性,,并可使用其他“ 基于虛擬的” 使用模型,;· Veloce DFT 可提升流片之前的可測(cè)試性設(shè)計(jì) (DFT) 驗(yàn)證速度,從而最大程度地降低了災(zāi)難性故障的風(fēng)險(xiǎn),,并極大減少了 DFT 插入后驗(yàn)證設(shè)計(jì)的運(yùn)行時(shí)間,;Veloce FastPath 在驗(yàn)證使用更快速的模型的多時(shí)鐘域的 SoC 設(shè)計(jì)中優(yōu)化硬件仿真性能。

       除了這些已經(jīng)推出的新型 Veloce Apps之外,,Mentor還將繼續(xù)擴(kuò)充 Veloce Apps 庫(kù),,以進(jìn)一步提升硬件仿真效率。

       這些新型Veloce Apps的推出,,也是和Mentor優(yōu)秀的Veloce OS 操作系統(tǒng)密不可分的,。Veloce OS 操作系統(tǒng)為Veloce 平臺(tái)增加了軟件可編程性和資源管理。最新升級(jí)的 Veloce OS3 涵蓋多項(xiàng)創(chuàng)新:集成全新的高性能計(jì)算平臺(tái),,削減 50% 的編譯時(shí)間,。“即插即用”的門(mén)電路級(jí)處理設(shè)置,,能接受平面或?qū)哟位O(shè)計(jì),。此流程可減少編譯所需的內(nèi)存量,從而提高性能,。新的流程可以更加輕松地加載和驗(yàn)證門(mén)級(jí)設(shè)計(jì),,提高硅保真的可信度。硬件仿真和軟件操作系統(tǒng)的時(shí)間能見(jiàn)度和時(shí)間波形調(diào)試與以前相比快2倍,,結(jié)合了從運(yùn)行時(shí)間到調(diào)試周期的軟件和硬件改進(jìn),,實(shí)現(xiàn)了更快可見(jiàn)性時(shí)間。


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