C64x+ DSP高速緩存一致性分析與維護
所屬分類：解決方案
上傳者：chenyy
文檔大?。?span>124 K
標簽： DSP
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文檔介紹：高速緩存(CACHE)作為內核和低速存儲器之間的橋梁，基于代碼和數(shù)據(jù)的時間和空間相關性,，以塊為單位由硬件控制器自動加載內核所需要的代碼和數(shù)據(jù),。如果所有程序和數(shù)據(jù)的存取都由內核完成,，基于CACHE的運行機制，內核始終能夠得到存儲器中最新的數(shù)據(jù),。但是當有其它可以更改存儲器內容的部件存在時,，例如不需要內核干預的直接數(shù)據(jù)存取（DMA）引擎,，就可能出現(xiàn)由于CACHE的存在而導致內核或者DMA不能夠得到最新數(shù)據(jù)的現(xiàn)象,，也就是CACHE一致性的問題。
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